题目内容
(请给出正确答案)
[单选题]
VHDL语言是一种结构化设计语言;一个设计实体(电路模块)包括实体与结构体两部分,结构体描述()。
A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
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A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
第1题
A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
第9题
A、体素特征是更为常见的创建实体毛坯的方法
B、体素特征是创建实体毛坯的一种方法
C、体素特征不能用于创建实体毛坯
D、UG NX6中,只能通过拉伸草图来创建实体毛坯
第10题
A.可以对共用体变量直接赋值
B.一个共用体变量中可以同时存放其所有成员
C.一个共用体变量中不能同时存放其所有成员
D.共用体类型定义中不能出现结构体类型的成员
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