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Quartus II中的FPGA的编程文件的后缀是

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第1题

为了使FPGA的下载文件掉电之后不丢失,可以将编程文件烧到FPGA的配置芯片里保存。FPGA器件每次上电时,作为控制器从配置器件EPCS主动发出读取数据信号,从而把EPCS的数据读入FPGA中,实现对FPGA的编程
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第2题

Quartus II中的FPGA的编程文件的后缀是

A.sof

B.bsf

C.pof

D.vhd

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第3题

CPLD编程和FPGA配置可以使用专用的编程设备,也可以使用下载电缆
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第4题

基于SRAM的FPGA具有掉电易失性,对该类器件的编程一般称为配置
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第5题

以下哪个可编程器件是基于与阵列可编程或阵列不可编程的原理:

A.PLA

B.FPGA

C.PROM

D.PAL

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第6题

以下哪个可编程器件是基于与阵列可编程或阵列不可编程的原理:

A.PLA

B.FPGA

C.PROM

D.PAL

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第7题

Quartus II中的CPLD的编程文件的后缀是
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第8题

下列哪个流程是正确的基于EDA软件的FPGA / CPLD设计流程

A.设计输入→分析综合→功能仿真→编程下载→硬件测试

B.设计输入→功能仿真→分析综合→编程下载→硬件测试;

C.设计输入→功能仿真→分析综合→编程下载→硬件测试;

D.原理图输入→功能仿真→适配→编程下载→综合→硬件测试

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第9题

下列对FPGA结构与工作原理的描述中,正确的是

A.FPGA全称为复杂可编程逻辑器件

B.FPGA是基于乘积项结构的可编程逻辑器件

C.基于SRAM的FPGA器件,在每次上电后必须进行一次配置

D.在Altera公司生产的器件中,MAX7000系列属FPGA结构

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第10题

下面对CPLD和FPGA的描述中,正确的是

A.CPLD器件内部为SRAM工艺,断电后编程信息立即丢失。

B.FPGA器件为EEPROM或FLAsH工艺,被编程后断电非易失。

C.CPLD器件为分段式互连结构,内部延时与器件结构和逻辑连接等有关,因此传输时延不可预测

D.CPLD器件为连续式互连结构,内部各模块之间具有固定时延的快速互连通道,可预测延时

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第11题

下列哪个流程是基于EDA软件的FPGA / CPLD一般设计流程

A.设计输入->逻辑设计->逻辑综合->功能仿真->布局布线->时序仿真->编程下载

B.逻辑设计->设计输入->逻辑综合->功能仿真->布局布线->时序仿真->编程下载

C.逻辑设计->设计输入->逻辑综合->时序仿真->布局布线->功能仿真->编程下载

D.逻辑设计->设计输入->逻辑综合->布局布线->功能仿真->时序仿真->编程下载

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