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[主观题]

实验四:12进制计数器1、 设计说明 我们已经掌握的同步、...

实验四:12进制计数器1、 设计说明 我们已经掌握的同步、异步触发器的相关知识,现在让我们利用JK触发器设计一个12进制计数器吧! 首先我们需要绘制12进制JK触发器设计的基本流程: 同步计数器的设计前我们首先需要熟悉J-K触发器的逻辑功能,掌握J-K触发器构成同步计数器方法,参考如下: 1.确定电路所需的触发器数目。 2.列出计数器的状态转换图。 3.根据状态转换图画出状态转换表。 4.根据状态转换表,写出J-K触发器的状态方程和驱动方程。 5.检查自启动性。 6.画出逻辑图。2、 选用仿真元件 2.1 JK触发器实验四:12进制计数器1、 设计说明 我们已经掌握的同步、...实验四:12进制计数器1、 设计说明2.2 常见门电路实验四:12进制计数器1、 设计说明 我们已经掌握的同步、...实验四:12进制计数器1、 设计说明三输入与门 非门 两输入或门3、 设计效果实验四:12进制计数器1、 设计说明 我们已经掌握的同步、...实验四:12进制计数器1、 设计说明12进制计数器评分标准 12进制计数器属于触发器课程的电路设计实验项目,该项目的完成要求具体如下: 1. 12进制计数器不能采用集成计数器芯片完成,只能用触发器设计,否则该项目不能计分。 2. 计数器的实现需要由四个触发器(同步或异步)设计而成,并通过数码管显示当前计数值,否则只能50%计入成绩。 3. 计数器可以设置一个清零键,该内容属于加分项。 4. 报告最后需加入本次实验的心得,字数不限,但切记雷同。 5. 报告请以“班级-学号-姓名”命名,以PDF格式上传至慕课平台。

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第1题

试设计一个带有控制端M的同步四进制可逆计数器。
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第2题

用JK触发器设计一个同步七进制计数器。要求能自启动。

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第3题

用PAL器件设计4位二进制同步加法计数器。

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第4题

用ROM和D触发器设计一个同步五进制加法计数器。
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第5题

用ROM和D触发器设计一个同步五进制加法计数器。
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第6题

设计一个可控同步计数器,要求能实现维持原态;二进制计数;三进制计数;四进制计数等4种不同操作,要求: (1)用D触发器和门电路实现设计; (2)用VHDL语言实现设计。

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第7题

用维持阻塞型D触发器和门电路设计一个同步六进制计数器。

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第8题

下图是由同步十六进制计数器74161组成的计数器电路,画出电路的状态图,说明是多少进制的计数器。

   

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第9题

74LS160是同步十进制计数器,用其设计一个带进位输出的24进制计数器。

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第10题

使用同步复位十六进制集成计数器74LS163设计8421BCD码模60计数器。

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