题目内容
（请给出正确答案）
[单选题]
某计数器的输出波形如下图所示，该计数器是（）进制计数器。
某计数器的输出波形如下图所示，该计数器是（）进制计数器。
A.6
B.6
C.1
D.2
E.3
F.4G、8
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某计数器电路如图所示，则该计数器为（ ）。
A、5进制计数器
B、6进制计数器
C、7进制计数器
D、8进制计数器
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第2题
某8421码十进制加法计数器集成单元的逻辑符号如图所示，其中C是进位输出端，加法计数到1001后输出脉冲；QA是最低位触发器输出端，QD是最高位触发器输出端；
是复位端。请在图上加上适当的连接线及门电路，构成61进制计数器。
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第4题
已知某集成计数器的结构图及逻辑符号如图所示，虚线以内为集成电路的内部电路。要求：
(1)单片计数器能实现的最大模值为多少；
(2)画出用该计数器实现五进制计数器的逻辑图；
(3)画出用该计数器实现六进制计数器的逻辑图；
(4)画出用该计数器实现三十进制计数器的逻辑图。
第6题
已知某可编程接口芯片中计数器的口地址为40H，计数频率为MHz，该芯片的控制字为 8位二进制数。控制字寄存数的口地址为43H，计数器达到0值的输出信号用作中断请求信号，执行下列程序后，发出中断请求信号的周期是【 】ms。
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MOV AL，00110110B ；计数器按二进制计数，16位读/写，
；可自动装载计数器初值
OUT 43H，AL
MOV AL，0FFH
OUT 40H，AL
OUT 40H，AL
.jpg){kind=spacer}
第8题
某时序逻辑电路如图所示，则该电路的逻辑功能描述正确的是： 
A、此电路为“计数器+译码器”结构的7相顺序脉冲发生器，F始终输出低电平。
B、此电路为7进制的计数器，F始终输出高电平。
C、此电路为“计数器+译码器”结构的6相顺序脉冲发生器，F始终输出高电平。
D、此电路为6进制的计数器，F始终输出低电平。
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