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JK触发器在JK输入信号的作用下可以工作在4个状态——置1,置0,保持和翻转

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第1题

主从触发器的时钟在高电平时,将输入信号传递到 。在低电平时,将信号传递到 。 (A)从触发器输出 (B)主触发器输出 (C)JK触发器输出 (D)D触发器输出

A.B、A

B.C

C.D、A

D.D

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第2题

对由JK触发器组成的异步加法计数器来讲,脉冲信号只与其的脉冲端子相连、各触发器的数据输入端应

A.最高位触发器,悬空

B.最高位触发器,接地

C.最低位触发器,悬空

D.最低位触发器,接地

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第3题

在设计同步时序逻辑电路时,实现相同功能,使用D触发器的电路一定比使用JK触发器的电路简单
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第4题

将两个J=K=1、由下降沿触发的JK触发器级联,如果将低位触发器的端接至高位触发器的脉冲输入触发端,就能实现二位二进制减法计数

A.CP

B.Q

C.Q反

D.J

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第5题

没有空翻现象的触发器有

A.主从RS触发器

B.维持阻塞RS触发器

C.维持阻塞D触发器

D.传输延迟JK边沿触发器

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第6题

指出下列哪种电路结构的触发器可以构成移位寄存器,哪些不能构成移位寄存器。如果能够,请在内画√,否则画×。 (A)RS锁存器(B)同步RS触发器(C)主从JK触发器(D)维持阻塞触发器(E)用CMOS传输门组成的边沿触发器

A.×、√、√、√、×

B.×、√、×、√、√

C.×、√、√、×、√

D.√、√、√、√

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第7题

JK触发器翻转的条件是

A.J=K=1

B.J=K=0

C.J=1,K=0

D.J=0,K=1

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第8题

分析传输延迟JK触发器之后, 发现CP在高电平时, 输出状态 。CP在低电平时,输出状态 。 (A)不变 (B)为0 (C)为1 (D)改变

A.C

B.A

C.A、A

D.D

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第9题

脉冲异步时序逻辑电路的存储电路由组成,电路输入信号为

A.触发器;脉冲信号

B.延迟元件;电平信号

C.触发器;电平信号

D.延迟元件;脉冲信号

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第10题

放大电路只有电源作用、没有输入信号时的状态称为静态,其在输入输出特性曲线上对应的点称为

A.交流、直流、静态工作点

B.直流、交流、静态工作点

C.交流、直流、动态工作点

D.交流、动态工作点

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第11题

在下列触发器中,输入没有约束条件的是

A.时钟R-S触发器

B.基本R-S触发器

C.主从J-K触发器

D.维持阻塞D触发器

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