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[主观题]

由D触发器的应用电路如图7-67所示,设触发器输出Q的初值为0,在时钟CP脉冲的作用下,输出Q为()。A.

由D触发器的应用电路如图7-67所示,设触发器输出Q的初值为0,在时钟CP脉冲的作用下,输出Q为()。

由D触发器的应用电路如图7-67所示,设触发器输出Q的初值为0,在时钟CP脉冲的作用下,输出Q为()

A.1

B.CP

C.脉冲信号,频率为时钟脉冲频率的1/2

D.0

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第1题

用3个D触发器组成的电路如图7-68所示,设Q2Q1Q0的初始状态为000,触发器F0的输入端接+5V表明D0=1,那么,在第1个CP脉冲和第2个脉冲的上升沿过后Q2Q1Q0分别是(  )。

A.010和011

B.010和001

C.001和011

D.000 111

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第2题

用3个D触发器组成的电路如图7-69所示,触发器F0的输入端接+5V表明D0=1,那么,在第1个CP脉冲和第2个脉冲的上升沿过后Q2Q1Q0分别是(  )。

A.101和011

B.011和111

C.001和011

D.000和111

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第3题

如图7-70所示电路,Q1、Q0的原始状态为11,当输入两个脉冲后的新状态为(  )。

A.00

B.01

C.11

D.10

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第4题

如图7-71所示,电路具有(  )。

A.保持功能

B.置“0”功能

C.置“1”功能

D.计数功能

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