题目内容
(请给出正确答案)
[主观题]
设计一个移存型序列信号发生器,其产生序列与预置初态满足表7.3.10。 表7.3.10 Q3 Q2
设计一个移存型序列信号发生器,其产生序列与预置初态满足表7.3.10。
表7.3.10 | ||||
Q3 | Q2 | Q1 | Q0 | 输出序列 |
0 1 1 0 | 1 1 0 0 | 1 1 0 0 | 0 1 0 0 | 011,011,… 111100.… 100010,… 全0序列 |
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设计一个移存型序列信号发生器,其产生序列与预置初态满足表7.3.10。
表7.3.10 | ||||
Q3 | Q2 | Q1 | Q0 | 输出序列 |
0 1 1 0 | 1 1 0 0 | 1 1 0 0 | 0 1 0 0 | 011,011,… 111100.… 100010,… 全0序列 |
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