题目内容
（请给出正确答案）
[单选题]
N进制计数器是指计数器的状态每经个计数脉冲循环一次（）
A.N-1
B.N
C.N+1
D.2N
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第2题
每经十个CP脉冲状态循环一次的计数电路，知其有效状态中的最大数为1100，则正确的描述是（）。
A. 模10计数器
B. B.计数器容量为10
C. C.十进制计数器
D. D.十二进制计数器
第3题
每经十个CP脉冲状态循环一次的计数电路，知其有效状态中的最大数为1100，则欠妥的描述是（）。
A. 模10计数器
B. B.计数容量为10
C. C.十进制计数器
D. D.十二进制计数器
第4题
试利用同步十六进制计数器74LS161和4线－16线译码器74LS154设计节拍脉冲发生器，要求从12个输出端顺序、循环地
试利用同步十六进制计数器74LS161和4线-16线译码器74LS154设计节拍脉冲发生器，要求从12个输出端顺序、循环地输出等宽的负脉冲。
第5题
用4位二进制加法计数器74161构成的计数器电路如图所示，则对该计数器应用电路功能描述正确的是（ ）。
A、余3码编码的十进制加法计数器
B、循环码编码的九进制加法计数器
C、余3码编码的三进制加法计数器
D、循环码编码的二进制加法计数器
第7题
用集成电路芯片74LS161设计一个计数器，自动完成3位二进制加／减循环计数，状态转换图如图T9.4－1(a)所示，要求
用集成电路芯片74LS161设计一个计数器，自动完成3位二进制加/减循环计数，状态转换图如图T9.4-1(a)所示，要求只能用三个2输入异或门和一个3输入与非门实现，如图T9.4-1(b)所示。
提示：将74LS161的输出作为输入变量，3位二进制加/减循环计数器的状态作为输出变量，列出状态转换真值表，其中状态1000不用，并用端作为加/减转换控制。
第9题
The modulus of a counter is 一个计数器的进制是指
A、the number of flip-flops. 触发器的个数。
B、the actual number of states in its sequence. 计数器序列中有效状态数。
C、The number of times it recycles in a second. 一秒内计数循环重复的次数。
D、the maximum possible number of states. 计数器最大可能的状态数。
第10题
用三个下降沿JK触发器及必要的与门设计一个步五进制计数器，其编码如下表所示，然后利用该计数器及3位二进制译码器组成一个周期序列信号发生器，每个周期的序列信号为01101，画出电路图，写出必要的过程。
| Q2 | Q1 | Q0 |
| 0 | 0 | 0 |
| 0 | 0 | 1 |
| 1 | 0 | 0 |
| 1 | 0 | 1 |
| 1 | 1 | 1 |
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