一片集成的十进制计数器可以构成()。
A.二进制计数器
B.一百进制计数器
C.八进制计数器
D.十六进制计数器
E.只能用作十进制计数器
A.二进制计数器
B.一百进制计数器
C.八进制计数器
D.十六进制计数器
E.只能用作十进制计数器
第2题
第3题
用74LS169中规模计数器构成可逆十进制计数器。加计数时,状态由0000递增到1001;减计数时,状态由1001递减到0000。外加的加/减控制信号为P,P=1时作加法,P=0时作减法。用一片74LS169和少量与非门完成这个设计,画出逻辑图。
第4题
分析图中两片中规模同步计数器CT74LS161构成的计数分频器的模值。第(1)片CT74LS161为低位计数器,第(2)片CT74LS161为高位计数器。并用两片同步十进制计数器集成芯片CT74LS160采用异步复位和级间同步连接法构成模值M=85的8421BCD计数器。
第5题
74LS192型同步十进制可逆计数器的功能表和逻辑符号分别如表21.3和图 21.16所示。所谓可逆,就是能进行加法计数和减法计数。(1)说明表中各项的意义;(2)试用两片74LS192型计数器构成百进制计数器。先将各片接成十进制加法计数工作状态,而后连接两片。图中分别为进位和借位输出端。
表21.3 | |||||
输入 | 输出 | ||||
RD | overline{LD} | CP+ | CP- | A3A2A1A0 | Q3Q2Q1Q0 |
0 0 | 0 1 | × ↑ | × 1 | d3d2d1d0 × | d3d2d1d0 加法计数 |
0 0 1 | 1 1 × | 1 1 × | ↑ 1 × | × × × | 减法计数 保持 0 0 0 0 |
第8题
第9题
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