题目内容（请给出正确答案）

[单选题]

Verilog 程序如下，则下列说法中正确的是 module Learn4_2（A,EN,Y） output [7:0] Y; input [2:0] A; input EN; reg [7:0] Y; wire [3:0] temp = {A,EN}; always case（temp) 4’b0001 : Y = 8’b00000001; 4’b0011 : Y = 8’b00000010;

A.当EN=1时，将二进制数A转换为其对应的独热码

B.因为缺少break,程序功能将无法实现

C.当EN=0时将输出全部置为1

D.该程序会生成锁存器

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第1题

Verilog Test Bench通过____将待测试的Verilog设计实体模块程序加入到Test Bench 程序中。

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第2题

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下列Verilog程序描述了图题2.5.5所示的电路，但程序中每一行有一个语法错误，请改正。(注意：基本门级元件的调用名可以省略)。

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第3题

【单选题】Verilog HDL程序中，若 s = 1，则执行完语句 y = s ？ a : b ; 后，y的值为_______。

A.a

B.b

C.1

D.0

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第4题

下列说法正确的是。

A.&&表示逻辑与

B.||表示逻辑或

C.&&表示与门实例化

D.Verilog中逻辑与的关键词是and

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第5题

说明下列Verilog程序所描述电路的功能，并画出逻辑电路图。

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第6题

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设有如下的程序段： int a[]＝(1，2，3，4，5)，*t； t=a；则下列说法正确的是()

A．a和t的内容相同

B．a数组的长度和t所指的字符串长度相等

C．a和t完全相同

D．指针变量t指向数组a的第一个元素

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第7题

程序段如下int k＝-20;while （k=0)k=k+1;则以下说法中正确的是（)A．while循环执行20次B．循环是无限

程序段如下 int k＝-20; while (k=0)k=k+1; 则以下说法中正确的是()

A．while循环执行20次

B．循环是无限循环

C．循环体语句一次也不执行

D．循环体语句执行一次

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第8题

Verilog 程序中设计源文件的后缀名是

A..xdc

B...sim

C..bit

D..v

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第9题

程序在数据段中定义数据如下： NUMS DB 20 DB 53 DB'JACK' 则对应下列指令的

程序在数据段中定义数据如下： NUMS DB 20 DB 53 DB'JACK'

则对应下列指令的描述符中正确的是()。

Ⅰ LEA DX， NUMS

Ⅱ MOVCL， [DX+2]

Ⅲ MOV BX， NUMS

A．Ⅰ、Ⅲ中指令都正确

B．Ⅰ正确，Ⅲ错误

C．Ⅰ错误，Ⅲ正确

D．Ⅰ，Ⅲ都不正确

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第10题

下列说法不正确的是哪一个？

A.Verilog HDL语言是一种硬件描述语言。

B.Verilog HDL语言是电子设计自动化的工具。

C.应用Verilog HDL语言设计电子电路，是硬件工程师应该掌握一项基本技能。

D.Verilog HDL语言没有固定的语法结构。

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