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[单选题]

设计时序电路时, 采用格雷码分配相邻状态的目的是，时序电路逻辑抽象和组合电路逻辑抽象的主要区别是。

A.简洁、自启动

B.避免竞争与冒险、状态转换

C.状态转换、自启动

D.避免竞争与冒险、无区别

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更多“设计时序电路时, 采用格雷码分配相邻状态的目的是，时序电路…”相关的问题

第1题

设计时序电路时, 采用格雷码分配相邻状态的目的是，时序电路逻辑抽象和组合电路逻辑抽象的主要区别是。

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第2题

同步时序电路设计中,状态编码采用相邻编码法的目的是(...

同步时序电路设计中,状态编码采用相邻编码法的目的是(?)

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第3题

组合逻辑电路设计中逻辑抽象的目的是得到______。而时序电路设计中逻辑抽象的目的是得到______。

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第4题

同步时序电路设计中，状态编码采用相邻编码原则的主要目的是（）。

A、减少电路中的逻辑门

B、减少电路中的触发器

C、提高电路速度

D、减少电路的级数

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第5题

用PLA和D触发器设计一个同步时序逻辑电路,电路的状态转换图如图8.11所示.画出相应的逻辑电路图.

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第6题

同步时序电路设计使用的相邻状态分配法中的改善效果不是指()。

A、相邻的‘0的’对数

B、相邻的‘1的’对数

C、相邻状态对数

D、相邻的‘0与’相邻的‘A的’对数之和

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第7题

在时序逻辑电路设计过程中，采用相邻编码法对最简状态表进行编码时，其遵循的原则有（）。

A、在相同输入条件下，具有相同次态的现态尽可能分配相邻的二进制代码

B、状态不变时分配相同的代码

C、在相邻输入条件下，同一现态的次态应尽可能分配相邻的二进制代码

D、输出完全相同的现态应尽可能分配相邻的二进制代码

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第8题

同步时序逻辑电路的设计中，触发器个数与电路中包含的状态数有关。()

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第9题

时序逻辑电路设计过程中，状态编码通常采用（）方法。

A、相对编码

B、相同编码

C、相邻编码

D、组合编码

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第10题

PAL芯片既可以设计组合逻辑电路，又可以设计时序逻辑电路

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