题目内容
（请给出正确答案）
[主观题]
假定CPU通过存储器总线读取数据的过程为:发送地址和读命令需1个时钟周期，存储器准备一个数据需8个时钟周期，总线上每传送1个数据需1个时钟周期。若主存和cache之间交换的主存块大小为64B，存取宽度和总线宽度都为8B，则cache的一次缺失损失至少为（）个时钟周期？
A.64
B.72
C.80
D.160
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A.64
B.72
C.80
D.160
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A.70
B.80
C.90
D.100
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