题目内容
（请给出正确答案）
[主观题]
请画出图7.4中的比较器和判断命中的逻辑图。
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第2题
某程序对逻辑页面访问的序列为P1P4P2P6P4P1P7P4P3P6P3P4P8P4P6。(1)设主存容量为3个页面.求执行FIFO和LRU页面替换算法时各自的命中率(假设开始时主存为空)。(2)当主存容量增加到4个页面时.两种替换算法各自的命中率又是多少?
第3题
计算机主存地址长度为32位,其cache容量为16KB,字块长度为4个32位的字，分别考虑直接地址映像和4路组相联地址映像两种情况。要求:(1)画出cache结构逻辑图,给出主存各个字段的长度。(2)给出访问主存地址为9A3CE5F8的单元(按字节编址)时,该单元在cache的位置。
第4题
某机主存容量为8个块.cache容量为4个块,采用直接地址映像。如果开始时，cache内容为空。今执行以下主存块地址序列:0、2、1、5、4、6、4、7、1、2、4、1、3、3、4。请列出.每次访存后cache中各块分配情况，cache命中情况及其命中率。
第5题
假设某高校学生人学考试总成绩已存入相联存储器中,每个学生有一个记录,有以下内容:准考证号、姓名、性别、年龄、志愿和总分。现要将总成绩大于559分的男生查找出来,请写出查找的方法和过程。
第6题
比较cache三种地址映像(直接映像、两路组相联映像、全相联映像)的命中率。假设主存储器的容量为8
块,cache的容量为4块，按下列(1)、(2)次序循环访问主存各块,求命中率(假设循环次数很多，忽略第1次循环对命中率的影响)。并讨论按下列(3)访存次序的两路组相联映像cache的命中率。
(1)访存次序:0,4,0,4,0,4,…
(2)访存次序:0,2,4,0,2,4,0,2,4,…
(3)访存次序:0,1,2,3,4,0,1,2,3,4,0,1,2,3,4…
第7题
判断以下有关主存储器的叙述的正确性，如有错误,请纠正。(1)现代计算机的主存储器速度由于半导
判断以下有关主存储器的叙述的正确性，如有错误,请纠正。
(1)现代计算机的主存储器速度由于半导体技术的进步而可以与CPU匹配。
(2)主存储器中的ROM与微程序控制存储器的ROM.由于它们都是ROM,所以可以统一使用。
(3)CPU执行的程序本身,必须先由应用程序从辅助存储器调入主存储器,然后才能执行。
(4)CPU执行的程序本身.必须先从主存储器调入cache,然后才能执行。
(5)在cache—主存层次中,为了提高cache命中率，可以采取的措施有:(a)增大cache容量，(b)增大主存容量，(c)程序编译优化。(d)选择适当的地址映像方式。
(6)CPU加电产生的reset(总清)信号.应将cache的全部有效位置“0”.并把主存储器中存储的所有内容都置“0”.以防程序运行出错。
第8题
某机有两级cache,假设CPU访向存储器1000次,第1级cache有50次不命中,通过第2级cache后，仍有10次不命中，求第1级cache和第2级cache的命中率以及总命中率。
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