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某动态RAM芯片,容量为64K×1位,除电源线、接地线和刷新线外,该芯片的最小引脚数量是多少?
[主观题]

某动态RAM芯片,容量为64K×1位,除电源线、接地线和刷新线外,该芯片的最小引脚数量是多少?

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第1题

某计算机字长16位,主存容量128KW,请用16K×8位的静态RAM芯片和32K×16位的ROM芯片,为该机设计一个主存储器。要求18000H~1FFFFH为ROM区,其余为RAM区。画出存储器结构及其与CPU连接的框图。

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第2题

对于32K字容量的存储器,若按字编址,字长16位。其地址寄存器应是多少位?数据寄存器是多少位?

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第3题

某磁盘存储器共有6个记录面,盘面内圈直径为1英寸,外圈直径为5英寸,道密度为50TPI,位密度为200

0BPI,转速为3000r/min,平均找道时间为10ms。

试问:

(l)该存储器的存储容量是多少?

(2)平均存取时间是多少?

(3)共有多少个圆柱面?

(4)数据传输率是多少?

(5)如果某文件的长度超过了一个磁道的容量,其超过部分应记录在同一记录面上,还是记录在同一回柱面上?

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第4题

主存容量为8MB,虚存容量为2GB,分页管理时若页面大小为4KB,求出对应的VPN、VPO、PPN、PPO的位数。

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第5题

假定某数组元素按行优先顺序存放在主存中,则以下两段伪代码A和B中: (1)分析两段代码中对数组

假定某数组元素按行优先顺序存放在主存中,则以下两段伪代码A和B中:

(1)分析两段代码中对数组访问的时间局部性和空间局部性.

(2)分析变量SUM的时间局部性和空间局部性.

(3)分析for循环体对指令访问的时间局部性和空间局部性.

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第6题

用16K×1位的DRAM芯片构成64K×8位的存储器,设存储器的读写周期为0.5μs,要使CPU在1μs内至少访问存储器一次,问采用哪种刷新方式比较合适?若每行刷新间隔不超过2ms,该方式下刷新信号的间隔是多少?

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第7题

设Cache的容量为2^14块,每块是一个32位字,主存容量是Cache容量的256倍,其中有如表所示数据(地

址和数据均采用16进制表示).

将主存中这些数据装入到Cache后,Cache各块中的数据内容及相应的标志是什么?

(1)全相联映射

(2)直接相联映射

(3)组相联映射

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第8题

某计算机中主存容量为4MB,Cache容量为16KB,每块包含8个字,每字32位,映射方式采用4路组相联.设Cache的初始状态为空,CPU依次从主存第0,1,2,…,99号单元读出100个字(每次读一个字),并重复此操作10次.替换算法采用LRU. (1)求Cache的命中率 (2)若Cache比主存块10倍,分析采用Cache后存储访问速度提高了多少?

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第9题

用32K×8位RAM芯片和64K×4位ROM芯片,设计256K×8位存储器。其中,从30000H到3FFFFH地址空间为只读存储区,其它为可读、可写存储区。完成存储器与CPU连接。

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第10题

试述多体交叉存储器的设计思想和实现方法。

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