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[单选题]

7485是一个()。

A.译码器

B.编码器

C.触发器

D.数值比较器

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第1题

TTL维持阻塞D触发器在( )触发。

A、时钟脉冲上升沿

B、时钟脉冲下降沿

C、时钟脉冲上升沿和下降沿都可

D、时钟脉冲上升沿和下降沿都不可

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第2题

把时钟JK触发器的两个输入端连接在一起可以构成一个时钟( )触发器。

A、RS

B、JK

C、D

D、T

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第3题

基本RS触发器有几个稳定状态?( )

A、一个

B、两个

C、三个

D、四个

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第4题

下列哪项可以影响组合逻辑电路某一时刻的输出?( )

A、电路的原有状态

B、此时刻前的输入

C、此时刻前的输出

D、此时刻的输入

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